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解决集成电路静电放电问题的电路布局专利

时间:2026-05-31    作者:admin 点击: ( 0 ) 次

【摘要】 一种解决集成电路静电放电问题的电路布局, 其 结构包含有内部电路、电源、地线、多个输出/输入端口接触垫、 以及一个电元件。该电源分成两组, 分别为VDDI和VDDE; 该 地线亦分成两组, 分别为VSSI和VSSE; 该电元件的地线单独连 接至VSSE或VSSI而接地; 所述输出/输入端口接触垫两边皆有 保护电路, 其由一个PMOS和一个NMOS所构成, 其中紧邻该电 元件的输出/输入端口接触垫皆以PMOS邻近该电元件; 所述电 元件之两旁更包含一基底保护环。。 【专利类型】发明申请 【申请人】盛群半导体股份有限公司 【申请人类型】企业 【申请人地址】台湾省新竹市科学工业园区研新二路三号 【申请人地区】中国 【申请人城市】台湾省 【申请号】CN98100148.3 【申请日】1998-01-20 【申请年份】1998 【公开公告号】CN1224240A 【公开公告日】1999-07-28 【公开公告年份】1999 【IPC分类号】H01L23/00 【发明人】高进南; 张治 【主权项内容】1.一种解决集成电路静电放电问题的电路布局,该电路布局包括 有: 一内部电路; 二电源,其中内部电压源做为内部电路的电源,而外部电压源做为 输出/输入端口电路的电源; 二地线,其中内部地线做为内部电路的地线,而外部地线做为输出/ 输入端口电路的地线: 一电元件,其地线单独连接至外部地线而接地; 多个输出/输入端口接触垫。 【当前权利人】盛群半导体股份有限公司 【当前专利权人地址】中国台湾新竹市 【被引证次数】5.0 【被他引次数】5.0 【家族被引证次数】5.0

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